SPC5606BF1MLQ6 NXP
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SPC5606BF1MLQ6 NXP
Merkmale • Single Issue, 32-Bit-CPU-Core-Komplex (e200z0h) – Konform mit der Embedded-Kategorie der Power Architecture-Technologie® – Erweiterter Befehlssatz, der die Codierung mit variabler Länge (VLE) zur Reduzierung des Platzbedarfs der Codegröße ermöglicht. Mit der optionalen Codierung von gemischten 16-Bit- und 32-Bit-Befehlen ist es möglich, den Platzbedarf des Codes erheblich zu reduzieren. • Bis zu 1,5 MB On-Chip-Code-Flash-Speicher, der mit dem Flash-Speicher-Controller unterstützt wird • 64 (4 × 16) KB On-Chip-Daten-Flash-Speicher mit ECC • Bis zu 96 KB On-Chip-SRAM • Memory Protection Unit (MPU) mit 8 Region-Deskriptoren und 32-Byte-Regionsgranularität für bestimmte Familienmitglieder (Weitere Informationen finden Sie in Tabelle 1.) • Interrupt-Controller (INTC) kann 204 Interrupt-Quellen mit wählbarer Priorität verarbeiten • Frequenzmodulierte Phasenregelschleife (FMPLL) • Crossbar-Switch-Architektur für gleichzeitige Zugriff auf Peripheriegeräte, Flash oder RAM über mehrere Bus-Master • 16-Kanal-eDMA-Controller mit mehreren Übertragungsanforderungsquellen über DMA-Multiplexer • Boot Assist Module (BAM) unterstützt die interne Flash-Programmierung über eine serielle Verbindung (CAN oder SCI) • Timer unterstützt I/O-Kanäle und bietet eine Reihe von 16-Bit-Funktionen zur Eingangserfassung, zum Ausgangsvergleich und zur Pulsweitenmodulation (eMIOS) • 2 Analog-Digital-Wandler (ADC): eine 10-Bit- und eine 12-Bit- • Cross-Trigger-Einheit zur Synchronisierung von ADC-Umwandlungen mit einem Timer-Ereignis aus dem eMIOS oder PIT • Bis zu 6 DSPI-Module (Serial Peripheral Interface)
Bis zu 10 LINFlex-Module (Serial Communication Interface) • Bis zu 6 erweiterte Full-CAN-Module (FlexCAN) mit konfigurierbaren Puffern • 1 I2C-Schnittstellenmodul (Inter-Integrated Circuit) • Bis zu 149 konfigurierbare Allzweck-Pins zur Unterstützung von Ein- und Ausgangsvorgängen (gehäuseabhängig) • Echtzeitzähler (RTC) • Taktquelle aus internem 128-kHz- oder 16-MHz-Oszillator zur Unterstützung des autonomen Aufwachens mit einer Auflösung von 1 ms und einer maximalen Zeitüberschreitung von 2 Sekunden • Optionale Unterstützung für RTC mit Taktquelle von externem 32-kHz-Quarzoszillator, der Wakeup mit einer Auflösung von 1 Sekunde und einer maximalen Zeitüberschreitung von 1 Stunde unterstützt • Bis zu 8 periodische Interrupt-Timer (PIT) mit 32-Bit-Gegenauflösung • Nexus-Entwicklungsschnittstelle (NDI) gemäß IEEE-ISTO 5001-2003 Class Two Plus • Geräte-/Platinen-Boundary-Scan-Tests werden gemäß Joint Test Action Group (JTAG) der IEEE (IEEE 1149.1) unterstützt • On-Chip-Spannungsregler (VREG) zur Regelung der Eingangsversorgung für alle internen Pegel
Merkmale • Single Issue, 32-Bit-CPU-Core-Komplex (e200z0h) – Konform mit der Embedded-Kategorie der Power Architecture-Technologie® – Erweiterter Befehlssatz, der die Codierung mit variabler Länge (VLE) zur Reduzierung des Platzbedarfs der Codegröße ermöglicht. Mit der optionalen Codierung von gemischten 16-Bit- und 32-Bit-Befehlen ist es möglich, den Platzbedarf des Codes erheblich zu reduzieren. • Bis zu 1,5 MB On-Chip-Code-Flash-Speicher, der mit dem Flash-Speicher-Controller unterstützt wird • 64 (4 × 16) KB On-Chip-Daten-Flash-Speicher mit ECC • Bis zu 96 KB On-Chip-SRAM • Memory Protection Unit (MPU) mit 8 Region-Deskriptoren und 32-Byte-Regionsgranularität für bestimmte Familienmitglieder (Weitere Informationen finden Sie in Tabelle 1.) • Interrupt-Controller (INTC) kann 204 Interrupt-Quellen mit wählbarer Priorität verarbeiten • Frequenzmodulierte Phasenregelschleife (FMPLL) • Crossbar-Switch-Architektur für gleichzeitige Zugriff auf Peripheriegeräte, Flash oder RAM über mehrere Bus-Master • 16-Kanal-eDMA-Controller mit mehreren Übertragungsanforderungsquellen über DMA-Multiplexer • Boot Assist Module (BAM) unterstützt die interne Flash-Programmierung über eine serielle Verbindung (CAN oder SCI) • Timer unterstützt I/O-Kanäle und bietet eine Reihe von 16-Bit-Funktionen zur Eingangserfassung, zum Ausgangsvergleich und zur Pulsweitenmodulation (eMIOS) • 2 Analog-Digital-Wandler (ADC): eine 10-Bit- und eine 12-Bit- • Cross-Trigger-Einheit zur Synchronisierung von ADC-Umwandlungen mit einem Timer-Ereignis aus dem eMIOS oder PIT • Bis zu 6 DSPI-Module (Serial Peripheral Interface)
Bis zu 10 LINFlex-Module (Serial Communication Interface) • Bis zu 6 erweiterte Full-CAN-Module (FlexCAN) mit konfigurierbaren Puffern • 1 I2C-Schnittstellenmodul (Inter-Integrated Circuit) • Bis zu 149 konfigurierbare Allzweck-Pins zur Unterstützung von Ein- und Ausgangsvorgängen (gehäuseabhängig) • Echtzeitzähler (RTC) • Taktquelle aus internem 128-kHz- oder 16-MHz-Oszillator zur Unterstützung des autonomen Aufwachens mit einer Auflösung von 1 ms und einer maximalen Zeitüberschreitung von 2 Sekunden • Optionale Unterstützung für RTC mit Taktquelle von externem 32-kHz-Quarzoszillator, der Wakeup mit einer Auflösung von 1 Sekunde und einer maximalen Zeitüberschreitung von 1 Stunde unterstützt • Bis zu 8 periodische Interrupt-Timer (PIT) mit 32-Bit-Gegenauflösung • Nexus-Entwicklungsschnittstelle (NDI) gemäß IEEE-ISTO 5001-2003 Class Two Plus • Geräte-/Platinen-Boundary-Scan-Tests werden gemäß Joint Test Action Group (JTAG) der IEEE (IEEE 1149.1) unterstützt • On-Chip-Spannungsregler (VREG) zur Regelung der Eingangsversorgung für alle internen Pegel
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