SPC5606BF1MLQ6 NXP
Verfügbar
SPC5606BF1MLQ6 NXP
• Single Issue, 32-Bit-CPU-Core-Komplex (e200z0h)
— Konform mit der Kategorie "Power Architecture® Technology Embedded"
– Erweiterter Befehlssatz, der eine Codierung mit variabler Länge (VLE) zur Reduzierung des Platzbedarfs der Codegröße ermöglicht. Mit der optionalen Codierung von gemischten 16-Bit- und 32-Bit-Befehlen ist es möglich, den Platzbedarf des Codes erheblich zu reduzieren.
• Bis zu 1,5 MB On-Chip-Code-Flash-Speicher, der mit dem Flash-Speicher-Controller unterstützt wird
• 64 (4 × 16) KB On-Chip-Daten-Flash-Speicher mit ECC
• Bis zu 96 KB On-Chip-SRAM
• Memory Protection Unit (MPU) mit 8 Regionsdeskriptoren und 32-Byte-Regionsgranularität für bestimmte Familienmitglieder (Weitere Informationen finden Sie in Tabelle 1.)
• Interrupt-Controller (INTC), der 204 Interrupt-Quellen mit wählbarer Priorität verarbeiten kann
• Frequenzmodulierter Phasenregelkreis (FMPLL)
• Crossbar-Switch-Architektur für den gleichzeitigen Zugriff auf Peripheriegeräte, Flash oder RAM von mehreren Bus-Mastern
• 16-Kanal-eDMA-Controller mit mehreren Übertragungsanforderungsquellen unter Verwendung eines DMA-Multiplexers
• Boot Assist Module (BAM) unterstützt die interne Flash-Programmierung über eine serielle Verbindung (CAN oder SCI)
• Der Timer unterstützt I/O-Kanäle und bietet eine Reihe von 16-Bit-Funktionen für Eingangserfassung, Ausgangsvergleich und Pulsweitenmodulation (eMIOS)
• 2 Analog-Digital-Wandler (ADC): ein 10-Bit- und ein 12-Bit-Wandler
• Cross Trigger Unit zur Synchronisierung von ADC-Umwandlungen mit einem Timer-Ereignis aus dem eMIOS oder PIT
• Bis zu 6 DSPI-Module (Serial Peripheral Interface)
• Bis zu 10 LINFlex-Module (Serial Communication Interface)
• Bis zu 6 erweiterte Full-CAN-Module (FlexCAN) mit konfigurierbaren Puffern
• 1 Schnittstellenmodul mit interintegrierten Schaltkreisen (I2 C)
• Bis zu 149 konfigurierbare Allzweck-Pins zur Unterstützung von Ein- und Ausgabevorgängen (gehäuseabhängig)
• Echtzeit-Zähler (RTC)
— Taktquelle aus internem 128-kHz- oder 16-MHz-Oszillator, der autonomes Aufwachen mit einer Auflösung von 1 ms und einer maximalen Zeitüberschreitung von 2 Sekunden unterstützt
— Optionale Unterstützung für RTC mit Taktquelle von externem 32-kHz-Quarzoszillator, Unterstützung von Wakeup mit einer Auflösung von 1 Sekunde und einem maximalen Timeout von 1 Stunde
• Bis zu 8 periodische Interrupt-Timer (PIT) mit 32-Bit-Zählerauflösung
• Nexus-Entwicklungsschnittstelle (NDI) gemäß IEEE-ISTO 5001-2003 Class Two Plus
• Unterstützung von Geräte-/Platinen-Boundary-Scan-Tests gemäß Joint Test Action Group (JTAG) von IEEE (IEEE 1149.1)
• On-Chip-Spannungsregler (VREG) zur Regelung der Eingangsversorgung für alle internen Pegel
• Single Issue, 32-Bit-CPU-Core-Komplex (e200z0h)
— Konform mit der Kategorie "Power Architecture® Technology Embedded"
– Erweiterter Befehlssatz, der eine Codierung mit variabler Länge (VLE) zur Reduzierung des Platzbedarfs der Codegröße ermöglicht. Mit der optionalen Codierung von gemischten 16-Bit- und 32-Bit-Befehlen ist es möglich, den Platzbedarf des Codes erheblich zu reduzieren.
• Bis zu 1,5 MB On-Chip-Code-Flash-Speicher, der mit dem Flash-Speicher-Controller unterstützt wird
• 64 (4 × 16) KB On-Chip-Daten-Flash-Speicher mit ECC
• Bis zu 96 KB On-Chip-SRAM
• Memory Protection Unit (MPU) mit 8 Regionsdeskriptoren und 32-Byte-Regionsgranularität für bestimmte Familienmitglieder (Weitere Informationen finden Sie in Tabelle 1.)
• Interrupt-Controller (INTC), der 204 Interrupt-Quellen mit wählbarer Priorität verarbeiten kann
• Frequenzmodulierter Phasenregelkreis (FMPLL)
• Crossbar-Switch-Architektur für den gleichzeitigen Zugriff auf Peripheriegeräte, Flash oder RAM von mehreren Bus-Mastern
• 16-Kanal-eDMA-Controller mit mehreren Übertragungsanforderungsquellen unter Verwendung eines DMA-Multiplexers
• Boot Assist Module (BAM) unterstützt die interne Flash-Programmierung über eine serielle Verbindung (CAN oder SCI)
• Der Timer unterstützt I/O-Kanäle und bietet eine Reihe von 16-Bit-Funktionen für Eingangserfassung, Ausgangsvergleich und Pulsweitenmodulation (eMIOS)
• 2 Analog-Digital-Wandler (ADC): ein 10-Bit- und ein 12-Bit-Wandler
• Cross Trigger Unit zur Synchronisierung von ADC-Umwandlungen mit einem Timer-Ereignis aus dem eMIOS oder PIT
• Bis zu 6 DSPI-Module (Serial Peripheral Interface)
• Bis zu 10 LINFlex-Module (Serial Communication Interface)
• Bis zu 6 erweiterte Full-CAN-Module (FlexCAN) mit konfigurierbaren Puffern
• 1 Schnittstellenmodul mit interintegrierten Schaltkreisen (I2 C)
• Bis zu 149 konfigurierbare Allzweck-Pins zur Unterstützung von Ein- und Ausgabevorgängen (gehäuseabhängig)
• Echtzeit-Zähler (RTC)
— Taktquelle aus internem 128-kHz- oder 16-MHz-Oszillator, der autonomes Aufwachen mit einer Auflösung von 1 ms und einer maximalen Zeitüberschreitung von 2 Sekunden unterstützt
— Optionale Unterstützung für RTC mit Taktquelle von externem 32-kHz-Quarzoszillator, Unterstützung von Wakeup mit einer Auflösung von 1 Sekunde und einem maximalen Timeout von 1 Stunde
• Bis zu 8 periodische Interrupt-Timer (PIT) mit 32-Bit-Zählerauflösung
• Nexus-Entwicklungsschnittstelle (NDI) gemäß IEEE-ISTO 5001-2003 Class Two Plus
• Unterstützung von Geräte-/Platinen-Boundary-Scan-Tests gemäß Joint Test Action Group (JTAG) von IEEE (IEEE 1149.1)
• On-Chip-Spannungsregler (VREG) zur Regelung der Eingangsversorgung für alle internen Pegel
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