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• Der i.MX 6Solo unterstützt Single Arm Cortex-A9 MPCore (mit TrustZone)
• Der i.MX 6DualLite unterstützt Dual Arm Cortex-A9 MPCore (mit TrustZone)
• Die Kernkonfiguration ist symmetrisch, wobei jeder Kern Folgendes umfasst:
— 32 KByte L1 Befehls-Cache
— 32 KByte L1 Daten-Cache
— Privater Timer und Watchdog
— Cortex-A9 NEON MPE (Media Processing Engine) Co-Prozessor
• Allgemeiner Interrupt Controller (GIC) mit 128 Interrupt-Unterstützung
• Globaler Timer
• Snoop-Steuereinheit (SCU)
• 512 KB einheitlicher I/D-L2-Cache:
— Wird von einem Kern in i.MX 6Solo verwendet
— Wird von zwei Kernen im i.MX 6DualLite geteilt
• Ausgabe des L2-Caches über zwei Master-AXI-Busschnittstellen
• Frequenz des Kerns (einschließlich NEON- und L1-Cache), gemäß Tabelle 8.
• NEON MPE-Coprozessor
— SIMD-Architektur für die Medienverarbeitung
— NEON-Registerdatei mit 32x64-Bit-Allzweckregistern
— NEON Integer Ausführungspipeline (ALU, Shift, MAC)
– NEON-Dual-Gleitkomma-Ausführungspipeline mit einfacher Genauigkeit (FADD, FMUL)
— NEON-Pipeline laden/speichern und permutieren
 
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